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A 14-bit 100-MS/s CMOS pipelined ADC featuring 83.5-dB SFDR 期刊论文
2016, 2016
赵南; 魏琦; 杨华中; 汪蕙; Zhao Nan; Wei Qi; Yang Huazhong; Wang Hui
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A 14-bit 50 MS/s sample-and-hold circuit for pipelined ADC 期刊论文
半导体学报(英文版), 2014, 卷号: 第35卷, 页码: P122-127
作者:  Yue Sen Zhao Yiqiang * Pang Ruilong Sheng Yun
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高精度流水线ADC关键子电路的研究设计 学位论文
2014, 2014
林春
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10位50MHz流水线模数转换器的研究 学位论文
2011, 2010
周林兵
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一种高速高精度采样/保持电路 期刊论文
2010, 2010
杨斌; 殷秀梅; 杨华中; Yang Bin; Yin Xiumei; Yang Huazhong
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一种高性能CMOS采样/保持电路 期刊论文
2010, 2010
刘民杰; 池保勇; 刘云峰; 董景新; Liu Minjie; Chi Baoyong; Liu Yunfeng; Dong Jingxin
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一种低功耗的13位100MS/s采样保持电路 期刊论文
2010
杨旭刚; 李开航; 周林兵
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A fast two-stage sample-and-hold amplifier for pipelined ADC application 其他
2008-01-01
Ruan, Jian; Lee, Chung Len
收藏  |  浏览/下载:1/0  |  提交时间:2015/11/10


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