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浏览/检索结果: 共1条，第1-1条 帮助 已选(0)清除 条数/页：5101520253035404550556065707580859095100   排序方式：请选择作者升序作者降序题名升序题名降序发表日期升序发表日期降序提交时间升序提交时间降序 Joint background calibration of gain and timing mismatch errors with low hardware cost for time-interleaved ADCs 期刊论文 IET CIRCUITS DEVICES & SYSTEMS, 2019, 卷号: 13, 页码: 203-210 作者:  Zhang, Jie;  Zhang, Hong;  Yang, Bo;  Zhang, Ruizhi 收藏  |  浏览/下载：27/0  |  提交时间：2019/11/19 offset mismatch  mixed-signal calibration  gain mismatch error estimation  two-channel TI ADC  calibration  0 bit  hardware cost reduction  timing mismatch error estimation  time measurement  analogue-digital conversion  gain measurement  word length 12  joint background calibration scheme  arithmetic blocks  time-interleaved analogue-to-digital conversion  cost reduction  multitap digital filters